Verilog 语言支持宏定义（define），参…
曼彻斯特编码（Manchester）是在通讯领域中…
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在Verilog语法中，向量可以按位（bit）引用…
Verilog 位运算符也是主要由与、或、非等逻辑…
逻辑运算符是Verilog语法中连接关系表达式，等…
在Verilog的建模中，时间尺度和延迟是非常重要…
Verilog语法中等式运算符包含==，!=，==…
Verilog中关系运算符有>, 大于；&g…
Verilog 运算符比常规的软件编程语言的运算符…
Verilog变量中每个位（bit）的数值类型有四…
上节介绍了wire，reg数据类型及其用法，并对变…
Verilog语法中最基本的数据类型有 线网（wi…
1. 标识符： Verilog HDL中的标识符是…
在上节课中我们介绍了在Verilog 中，逻辑电路…
模块（module）是verilog 语言中最基本…
Verilog HDL是一种硬件描述语言（HDL:…
Verilog 10b/8b解码 代码 [cray…
一、FPGA与Verilog课程简介 课程简介 F…
上一篇文章里，我们介绍了rx模块在参数固定时后的写…
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前两贴我们实现了uart的发送模块，这一贴我们实现…
上一个帖子中我做了固定参数的uart方案，如果模块…