本文主要给大家介绍如何在仿真中使用forkR…
1、我们经常会使用PLL产生的locked信号作为…
在SPI接口的EEPROM的原理与使用中给大家介绍…
上节内容讲解了状态机的基本理论、分类以及在数字电路…
1.FPGA固化/烧录程序到FLASH原理 在使用…
在日常生活或工作中希望在特定条件下有步骤的做事，计…
文章 Xilinx专用设计代码风格中提到从FPGA…
FII_RISCV_V2.01.002版本详情如下…
在学习本节课之前需要一些预备知识：文章Verilo…
之前学习了许多和Verilog文件操作相关的函数，…
Vivado下FIFO IP核除了文章FIFO I…
1. 下示的工程中8-bit宽的 2 对 1 多路…
1. 建立一个没有input和一个output的电…
在串行高速通信的发送端加入乒乓Buffer缓冲后，…
在上节课Vivado真双端口（TDP）RAM IP…
前几节课在Vivado下学习并使用了ROM IP核…
正弦波（sine wave）在工程中有着重要的意义…
在上节课Vivado Block ROM 的生成与…
在Vivado下，Xilinx公司提供了很多实用的…
在异步通信中数据位的提取至关重要，如果能够准确的把…
上一篇文章Vivado软件 调试工具的使用初步中简…
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如果在FPGA配置之后仍然想访问非通用输入输出的管…
1. eth_phy_core.v eth_phy…
top.v 是整个网络综合实验工程的顶层模块，如图…